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銀鐵人
Amateur Member
 
銀鐵人的大頭照
 

加入日期: Apr 2017
文章: 31
牙膏邀請極客灣參訪18A廠,這是什麼操作看不懂
https://youtu.be/c81zc5lS_pc?si=iaVe6PkqBgXpHihP
     
      
舊 2025-10-13, 08:00 PM #91
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銀鐵人現在在線上  
anderson1127
Elite Member
 

加入日期: Jan 2002
文章: 4,032
引用:
作者銀鐵人
牙膏邀請極客灣參訪18A廠,這是什麼操作看不懂
[delete]


不就公開自己寫的作業本給大家抄嘛 , 反正本來就不及格了, 公開給大家抄也只是造成更多的不及格同學嘛....
 
__________________
您想買新硬碟嗎? 購買前請務必參考這篇文章,是我的實際經驗

還想讓統一賺你的錢嗎?統一集團成員(能見度高的):
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統一LP33膠囊有環保署早已列管的一級管制品: DNOP塑化劑
舊 2025-10-13, 08:34 PM #92
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anderson1127離線中  
mobilestubsars
Basic Member
 

加入日期: Jun 2021
文章: 23
當大家都不看好INTC的時候,這檔股票已經默默的漲了快一倍,有趣。
舊 2025-10-14, 12:32 AM #93
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mobilestubsars離線中  
skap0091
Master Member
 

加入日期: May 2021
文章: 1,985
引用:
作者銀鐵人
牙膏邀請極客灣參訪18A廠,這是什麼操作看不懂
https://youtu.be/c81zc5lS_pc?si=iaVe6PkqBgXpHihP

宣傳自家新產品啊

看了一下只有CPU Die用上18A

其他部分都還是台積電的樣子

只能說產能or成本很迷
舊 2025-10-14, 12:45 AM #94
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skap0091離線中  
u8526425
Elite Member
 

加入日期: Oct 2002
文章: 4,803
但是晶背供電+GAA的技術導入
讓人好奇可以帶來什麼實質變化
__________________
人性的醜陋就是,會在無權、無勢、善良的人身上挑毛病,卻在有權、有勢、缺德的人身上找優點。當無權、無勢、善良的人受到傷害的時候,還會站在所謂的道德制高點上,假惺惺地勸說無權、無勢、善良的人,一定要忍耐,一定要大度。
舊 2025-10-14, 09:19 AM #95
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u8526425離線中  
銀鐵人
Amateur Member
 
銀鐵人的大頭照
 

加入日期: Apr 2017
文章: 31
晶背供電線路就不用擠在同一面上,製程也可以微縮

此文章於 2025-10-14 09:44 AM 被 銀鐵人 編輯.
舊 2025-10-14, 09:41 AM #96
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銀鐵人現在在線上  
u8526425
Elite Member
 

加入日期: Oct 2002
文章: 4,803
晶背供電與GAA都是突破製程微縮瓶頸的關鍵技術
三大廠都有類似的技術積累
但intel A18製程是首次同時集成晶背供電與GAA的商業化製程
所以好奇會有多少進步
__________________
人性的醜陋就是,會在無權、無勢、善良的人身上挑毛病,卻在有權、有勢、缺德的人身上找優點。當無權、無勢、善良的人受到傷害的時候,還會站在所謂的道德制高點上,假惺惺地勸說無權、無勢、善良的人,一定要忍耐,一定要大度。
舊 2025-10-14, 10:11 AM #97
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u8526425離線中  
巴豆布妖
New Member
 
巴豆布妖的大頭照
 

加入日期: Apr 2017
文章: 8
引用:
作者hendry2002
input wire clk, // System clock
input wire rst_n, // Active low reset
...
input wire rxd, // CAN bus receive input
output reg txd, // CAN bus transmit output
...
input wire [7:0] host_addr, // Address bus
input wire [31:0] host_data_in, // Data input bus

先說明一下, 沒有想要介入你們的討論. 單純無聊看一下 (AI?) 寫的 Verilog
can bus 是 differential serial signal, 所以這顆 ic 有 can hight 和 can low 及 cs 和 rst
蠻特別的是 can 是 serial signal, 常見對接的 device (host?) 我看的大多也都是 serial
但你們是 parallel signal 用 32bit data, 這好少見, 你們是接什麼?
舊 2025-10-14, 12:34 PM #98
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巴豆布妖離線中  
lifaung
Senior Member
 

加入日期: Aug 2001
您的住址: 台中or桃園
文章: 1,134
引用:
作者銀鐵人
牙膏邀請極客灣參訪18A廠,這是什麼操作看不懂
https://youtu.be/c81zc5lS_pc?si=iaVe6PkqBgXpHihP


餓死的駱駝比馬大....

intel還是有相當底蘊, 只要不要和他談代工(代工和自己設計製造很不一樣, 他們家阿三們應付不來)
舊 2025-10-14, 02:38 PM #99
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lifaung離線中  
lifaung
Senior Member
 

加入日期: Aug 2001
您的住址: 台中or桃園
文章: 1,134
引用:
作者巴豆布妖
先說明一下, 沒有想要介入你們的討論. 單純無聊看一下 (AI?) 寫的 Verilog
can bus 是 differential serial signal, 所以這顆 ic 有 can hight 和 can low 及 cs 和 rst
蠻特別的是 can 是 serial signal, 常見對接的 device (host?) 我看的大多也都是 serial
但你們是 parallel signal 用 32bit data, 這好少見, 你們是接什麼?


就小弟淺薄的知識舉一個例子, ABS controller其實後面是parallel的信號輸出
在我認知裡面對於timing有嚴格及時要求的會用parallel

舉例來說, LCD外部接口可能換成了EDP, 但是內部to source/ gate driver還是並列傳輸

印表機的印刷頭也是並列傳輸的(噴墨)
舊 2025-10-14, 02:51 PM #100
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lifaung離線中  


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